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논문 기본 정보
- 자료유형
- 학술저널
- 저자정보
- 저널정보
- Korean Institute of Information Scientists and Engineers Journal of Electrical Engineering and Information Science Journal of Electrical Engineering and Information Science Vol.3 No.2
- 발행연도
- 1998.4
- 수록면
- 139 - 144 (6page)
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This paper describes the design of a variable rate QPSK demodulator for digital satellite TV system. This true variable-rate demodulator employs a unique architecture to realize an all digital synchronization and detection algorithm. Data-flow based design approach enabled a seamless transition from high level design optimization to physical layout. The demodulator has been integrated with Viterbi decoder, de-interleaver, and Reed-Solomon decoder to make a single chip Digital Video Broadcast (DVB) receiver. The receiver IC has been fabricated with a 0.5mm CMOS TLM process and proved fully functional in a real-world set-up.
목차
Abstract
Ⅰ. Introduction
Ⅱ. Digital Demodulator Algorithm and Architecture Design
Ⅲ. Data-Flow Based Design Methodology
Ⅳ. Digital Demodulator Implementation
Ⅴ. Chip Implementation
Ⅵ. Conclusion
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