통신용 DSP를 위한 비트 조작 연산 가속기의 설계

정석현; 선우명훈

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자료유형: 학술저널

저자정보: 정석현 선우명훈

저널정보: 대한전자공학회 전자공학회논문지-TC 전자공학회논문지 TC편 제42권 제8호

발행연도: 2005.8

수록면: 11 - 16 (6page)

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본 논문은 스크램블링(Scrambling), 길쌈부호화(Convolutional Encoding), 펑처링(Puncturing), 인터리빙(Interleaving) 등과 같은 연산에 공통적으로 필요한 비트 조작(Bit Manipulation)을 효율적으로 지원하기 위한 비트 조작 연산 가속기를 제안한다. 기존의 DSP는 곱셈 및 가산 연산을 기본으로 연산기가 구성되어 있으며 워드 단위로 동작을 함으로 비트 조작 연산의 경우 비효율적인 연산을 수행할 수밖에 없다. 그러나 제안한 가속기는 비트 조작 연산을 다수의 데이터에 대해 병렬 쉬프트와 XOR 연산, 비트 추출 및 삽입 연산을 효율적으로 수행할 수 있다. 제안한 가속기는 VHDL로 구현 하여 삼성 0.18㎛ 표준 셀 라이브러리를 이용하여 합성하였으며 가속기의 게이트 수는 1,700개에 불과하다. 제안한 가속기를 통해 스크램블링, 길쌈부호화, 인터리빙을 수행시 기존의 DSP에 비해 40~80%의 연산 사이클의 절감이 가능하였다.

참고문헌 (13)

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[학술지(정기간행물)] - / July2003. / Flexible Hardware Structures for CDMA Systems

[학술지(정기간행물)] - / oct.2000 / Trends in compilable DSP architecture : 181 ~ 199

[학술지(정기간행물)] - / April2002. / Reconfigurability requirements of wireless communication systems

[학술지(정기간행물)] - / aug.2003. / Application-specific DSP architecture for OFDM modem systems

[학술지(정기간행물)] - / May2001 / PN-generators embedded in high performance signal processors : 45 ~ 48

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정석현

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주요연구분야 공학 > 전기전자공학 > 정보통신공학 공학 > 전기전자공학 > 전자공학

논문수 14 이용수 244

선우명훈

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논문수 132 이용수 4,456

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