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한국정보보호학회 정보보호학회논문지 정보보호학회논문지 제16권 제6호
발행연도
2006.12
수록면
15 - 24 (10page)

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최근 휴대용 기기의 중요성이 증가하면서 이에 적합한 암호 구현이 요구되고 있으나, 기존의 암호 구현 방식이 속도에 중점을 두고 있어 휴대용 기기에서 요구하는 전력 소모나 면적을 만족하지 못하고 있다. 따라서 휴대용 기기에 적합한 암호 알고리즘의 경량 구현이 매우 중요한 과제로 떠오르고 있다. 이 논문에서는 국내 KS 표준 알고리즘인 ARIA 알고리즘을 32-비트 구조를 이용하여 경량화하는 방법을 제안한다. 확산 계층의 새로운 설계를 이용하여 구현된 결과는 아남 0.25um 공정에서 11301 게이트를 차지하며, 128-비트 키를 이용할 때 87/278/256 클락 (초기화/암호화/복호화)을 소모한다. 그리고 128-비트 키만을 지원하는 기존의 구현과 달리, 256-비트 키까지 지원하도록 구성하여 ARIA 알고리즘의 표준을 완벽히 구현하였다. 이를 통해 지금까지 알려진 가장 경량화된 구현 결과와 비교하면 면적은 7% 감소, 속도는 13% 향상된 결과이다.
#ARIA processor #Diffusion #Light Weight #gate count

목차

요약
ABSTRACT
Ⅰ. 서론
Ⅱ. 관련분야의 연구
Ⅲ. ARIA 알고리즘
Ⅳ. 32-비트 구조 ARIA 연산기의 아키텍쳐
Ⅴ. 구현결과
Ⅵ. 결론
참고문헌
〈著者紹介〉

참고문헌 (13)

참고문헌 신청
1. [학술지(정기간행물)] - / nov.2001 / Specification for the AES google schola 2. [학술지(정기간행물)] - / Jan.2003 / Security and Performance Analysis of ARIA google schola 3. [학술지(정기간행물)] - / apr.2004. / ARIA 암호 알고리듬의 하드웨어 설계 및 구현 42 (4) : 26 ~ 36 google schola 4. [학술지(정기간행물)] - / Jun.2005. / 유비쿼터스 환경에 적합한 블록암호 ARIA의 S-Box FPGA 구현 : 621 ~ 625 google schola 5. [학술지(정기간행물)] - / dec.2005. / A Scale Down Structure of ARIA Processor : 79 ~ 84 google schola

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