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논문 기본 정보

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대한전자공학회 전자공학회논문지-SD 電子工學會論文誌 SD編 第44卷 第9號
발행연도
2007.9
수록면
48 - 53 (6page)

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Fast Fourier Transform (FFT)과 같은 디지털 신호처리 응용에서는 계수가 미리 정해진 특정 그룹의 곱셈기를 사용한다. 본 논문에서는 수정된 CSD 알고리즘 및 부분곱 공유 알고리즘을 기반으로 계수가 미리 정해진 특정 그룹의 곱셈 계수를 위한 효율적인 곱셈기 설계 방법을 제안한다. 제안한 알고리즘을 direct digital frequency synthesizer (DDFS)에 사용되는 sine/cosine 생성회로 및 128 point radix-2⁴ FFT에 사용되는 곱셈기에 적용하였을 경우 기존 곱셈에 비하여 면적, 소비전력, 속도에서 최대 34%의 이득이 있음을 CAD 시뮬레이션을 통해 보인다.

목차

요약
Abstract
Ⅰ. 서론
Ⅱ. 기존의 Radix-2⁴ FFT의 곱셈블록
Ⅲ. 효율적인 그룹 곱셈기 설계방법
Ⅳ. 시뮬레이션 및 비교
Ⅴ. 결론
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