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논문 기본 정보
- 자료유형
- 학술저널
- 저자정보
- 발행연도
- 2008.7
- 수록면
- 1 - 8 (8page)
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Low Density Parity Check codes(LDPC)는 최근 우수한 성능으로 통신 분야에서 채널 코딩의 중요한 블록으로 주목받고 있다. 그리하여 Wibro를 포함한 여러 표준에서 LDPC 부호를 채널 코딩으로 채택하고 있다. 이러한 LDPC 부호의 Encoder를 구현하는데 있어서의 약점은 기존의 이진 Matrix Vector Multiplier가 throughput의 감소의 원인이 되는 clock cycle이 많다는 것이다. 본 논문은 표준에서 사용되는 H 행렬이 Circulant Permutation Matrix(CPM)로 정의되어 있다는 점을 이용하여 인코더의 구현에 있어서 기존의 Matrix Vector Multiplier 대신에 cyclic shift register와 exclusive-OR을 사용하는 설계구조를 제안한다. 또한, 제안한 구조를 이용하여 WiBro에 포함되는 다양한 부호율에 적용가능한 인코더를 설계하였다. 제안된 WiBro LDPC의 인코더는 기존보다 적은 clock cycle을 가지므로 높은 throughput에 도달한다.
목차
요약
Abstract
Ⅰ. 서론
Ⅱ. Background
Ⅲ. 제안한 LDPC 인코더 구조
Ⅳ. LDPC 인코더의 구현
Ⅴ. 결론
참고문헌
저자소개
참고문헌 (8)
참고문헌 신청
1. [학술대회논문] - Marc. P.C. Fossorier / 2003 / Quasi-cyclic low density parity check codes / 2003 IEEE Int. Symp. Information Theory (ISIT 2003) : 150 ~
2. [학술지(정기간행물)] - T.J. Richardson / 2001 / Efficient Encoding of Low Density Parity Check Codes / IEEE Trans. IT 47 : 638 ~ 856
3. [학술대회논문] - L.Dong-U / 2004 / A flexible hardware encoder for low density parity check codes / IEEE Symp. Field- Programmable Custom Computing
4. [단행본] - Zahid Khan / 2007 / Pipelined Implementation of a Real Time Programmable Encoder for Low Density Parity Check Code on a Reconfigurable Instruction Cell Architecture / Design, Automation & Test
5. [기타자료] - / 2005 / IEEEP802.16/D12
2. [학술지(정기간행물)] - T.J. Richardson / 2001 / Efficient Encoding of Low Density Parity Check Codes / IEEE Trans. IT 47 : 638 ~ 856
3. [학술대회논문] - L.Dong-U / 2004 / A flexible hardware encoder for low density parity check codes / IEEE Symp. Field- Programmable Custom Computing
4. [단행본] - Zahid Khan / 2007 / Pipelined Implementation of a Real Time Programmable Encoder for Low Density Parity Check Code on a Reconfigurable Instruction Cell Architecture / Design, Automation & Test
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