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목차
Abstract
1. 서론
2. 연산공유 승산 알고리즘
3. 연산공유 승산기를 이용한 내적 연산기 구조
4. 연산공유 승산기를 이용한 DCT 프로세서 구조
5. 성능비교 및 시뮬레이션
6. 결론
감사의 글
참고문헌
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참고문헌 (10)
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[학술지(정기간행물)] - J.S. Park / 2002. / Low power reconfigurable DCT design based on sharing multiplication 3 : 3116 ~ 3119
[학술지(정기간행물)] - S.K. Kwon / 2002. / DCT processor architecture based on computation sharing : 162 ~ 165
[학술지(정기간행물)] - S.A. White / jul.1989. / Applications of distributed arithmetic to digital signal processing : 1 ~ 19
[학술지(정기간행물)] - G.M. Blair / mar.1998. / Design for the discrete cosine transform in VLSI 145 (2) : 127 ~ 133
[학술지(정기간행물)] - Bernie New / aug.1995. / A distributed arithmetic approach to designing scalable DSP chips aug-17 : 107 ~ 114
[학술지(정기간행물)] - S.K. Kwon / 2002. / DCT processor architecture based on computation sharing : 162 ~ 165
[학술지(정기간행물)] - S.A. White / jul.1989. / Applications of distributed arithmetic to digital signal processing : 1 ~ 19
[학술지(정기간행물)] - G.M. Blair / mar.1998. / Design for the discrete cosine transform in VLSI 145 (2) : 127 ~ 133
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