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논문 기본 정보

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학술대회자료
저자정보
Ickhyun Song (서울대학교) Hee-Sauk Jhon (서울대학교) Hakchul Jung (서울대학교) Minsuk Koo (서울대학교) Yehao Shen (서울대학교) Hyungcheol Shin (서울대학교)
저널정보
대한전자공학회 대한전자공학회 학술대회 2008년도 SOC 학술대회
발행연도
2008.5
수록면
211 - 214 (4page)

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이 논문의 연구 히스토리 (2)

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3-5 ㎓ 저전력 광대역 수신단을 위한 CMOS 저전압 증폭기가 설계되었으며 비용이 저렴한 1 Poly-6 metal의 0.18-㎛ mixed signal 공정이 사용되었다. 광대역 입력단 정합을 위해서 저항을 이용한 귀환 회로 구조가 사용되었고 소스 쪽 인덕터를 없앰으로서 면적을 줄일 수 있었다. 출력단 정합을 위해서는 source follower 구조가 사용되었다. 설계된 회로는 목표 주파수에서 적절한 정합 특성과 13.7 ㏈의 최대 이득을 있었고, 평균 4.1 ㏈의 잡음 지수를 나타냈다. 회로의 두 단 및 바이어스 회로까지 포함한 총 전력 소모는 6.65 ㎽로 저전력 수신단 설계에 적합함을 알 수 있었다.

목차

요약
Abstract
Ⅰ. Introduction
Ⅱ. UWB LNA Design
Ⅲ. Simulation Results
Ⅳ. Conclusion
Acknowledgment
References

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