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이용수
Abstract
1 Introduction
2 Pipelined-ADC Architecture
3 Circuit Design
4 Simulation Results
5 Conclusion
References
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저전력 8비트 10MS/s 파이프라인 ADC 설계
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2008 .06
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기준 전압 스케일링을 이용한 12비트 10MS/s CMOS 파이프라인 ADC
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A 9-bit ADC with a Wide-Range Sample-and-Hold Amplifier
대한전자공학회 ISOCC
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