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논문 기본 정보
- 자료유형
- 학술대회자료
- 저자정보
- 발행연도
- 2004.10
- 수록면
- 624 - 627 (4page)
이용수
이 논문의 연구 히스토리 (3)
2006
A 0.12㎓-1.4㎓ DLL-based Clock Generator with a Multiplied 4-phase Clock Using a 0.18㎛ CMOS Process
Hyung-Joon Chi
,
Jae-seung Lee
,
Jae-Yoon Sim
외 2명
JOURNAL OF SEMICONDUCTOR TECHNOLOGY AND SCIENCE
2006.12
학술저널
A 0.12GHz-1.4GHz DLL-based clock generator with a multiplied 4-phase clock using a 0.18um CMOS Process
Hyung-Joon Chi
,
Jae-seung Lee
,
Hong-June Pa
외 1명
대한전자공학회 ISOCC
2006.10
학술대회자료
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목차
Abstract
1 Introduction
2 Architecture
3 Simulation results
4 Conclusion
5 Acknowledgements
6 References
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1992 .07
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대한전자공학회 학술대회
1992 .06
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