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논문 기본 정보

자료유형
학술저널
저자정보
Shi Dai (인하대학교) Sang Min Lee (인하대학교) Kwang Sub Yoon (인하대학교)
저널정보
한국통신학회 한국통신학회논문지 한국통신학회논문지 제38권 제4호(통신이론 및 시스템)
발행연도
2013.4
수록면
303 - 309 (7page)

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입력 전압 범위 감지 회로를 이용해서 저전력 6비트 플래시 500Ms/s ADC를 설계하였다. 입력 전압 범위 감지 회로는 변환기내 모든 비교기들 중에서 25%만 동작시키고, 나머지 75%는 동작시키지 않는 방법을 채택하므로 저전력 동작을 가능하게 설계 및 제작하였다. 설계된 회로는 0.13um CMOS 공정기술을 이용해서 제작하였고, 1.2V 전원전압에서 68.8mW 전력소모, 4.9 유효 비트수, 4.75pJ/step의 평가지수가 측정되었다.
#Analog-to-Digital Converter #flash #range detection circuits

목차

요약
ABSTRACT
Ⅰ. Introduction
Ⅱ. Input Voltage Range Detection Circuits
Ⅲ. Measurement Results
Ⅳ. Summary
References

참고문헌 (1)

참고문헌 신청
이한울, 시대, 유태경, 이건, 윤광섭, 이상민. 스위치드 연산증폭기를 이용한 CMOS 단일비트 3차 델타시그마 변조기 설계. 한국통신학회논문지. 2012 dbpia

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UCI(KEPA) : I410-ECN-0101-2014-560-003652455