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논문 기본 정보
- 자료유형
- 학술저널
- 저자정보
- 발행연도
- 2013.2
- 수록면
- 414 - 422 (9page)
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본 논문은 분할-커패시터 기반의 차동 디지털-아날로그 변환기 (DAC: digital-to-analog converter)를 이용하는 10-bit 10-MS/s 비동기 축차근사형 (SAR: successive approximation register) 아날로그-디지털 변환기 (ADC: analog-to-digital converter)를 제안한다. 샘플링 주파수를 증가시키기 위해 SAR 로직과 비교기는 비동기로 동작을 한다. 또한 높은 해상도를 구현하기 위해 오프셋 보정기법이 적용된 시간-도메인 비교기를 사용한다. 제안하는 10-bit 10-MS/s 비동기 축차근사형 아날로그-디지털 변환기는 0.18-μm CMOS 공정에서 제작되며 면적은 140 × 420 μm²이다. 1.8 V의 공급전압에서 전력소모는 1.19 mW이다. 101 kHz 아날로그 입력신호에 대해 측정된 SNDR은 49.95 dB이며, DNL과 INL은 각각 +0.57/-0.67, +1.73/-1.58이다.
목차
요약
ABSTRACT
Ⅰ. 서론
Ⅱ. 비동기 SAR ADC
Ⅲ. 비동기 SAR ADC의 구성
Ⅳ. 칩 제작 및 측정 결과
Ⅴ. 결론
참고문헌
참고문헌 (6)
참고문헌 신청
1. [학술지(정기간행물)] - Cho, S.-H / 2011 / A 550-uW 10-b 40-MS/s SAR ADC With Multistep Addition-Only Digital Error Correction / IEEE J. Solid-State Circuits 46 (8) : 1881 ~ 1892
2. [학술대회논문] - S.-K. Lee / 2009 / A 1.3μW 0.6V 8.7-ENOB Successive Approximation ADC in a 0.18μm CMOS / Proc. IEEE VLSI Circuit Symp : 242 ~ 243
3. [학술지(정기간행물)] - C.C. Liu / 2010 / A 10-bit 50-MS/s SAR ADC with a Monotonic Capacitor Switching Procedure / IEEE J. Solid-State Circuits 45 (4) : 731 ~ 740
4. [학술지(정기간행물)] - J. Yang / 2010 / A 1 GS/s 6 Bit 6.7 mW successive approximation ADC using asynchronous processing / IEEE J. Solid-State Circuits 45 (8) : 1469 ~ 1478
5. [학술지(정기간행물)] - S.-W.M. Chen / 2006 / A 6b 600MS/s 5.3mW Asynchronous ADC in 0.13-μm CMOS / IEEE J. Solid-State Circuits 41 (12) : 2669 ~ 2680
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3. [학술지(정기간행물)] - C.C. Liu / 2010 / A 10-bit 50-MS/s SAR ADC with a Monotonic Capacitor Switching Procedure / IEEE J. Solid-State Circuits 45 (4) : 731 ~ 740
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5. [학술지(정기간행물)] - S.-W.M. Chen / 2006 / A 6b 600MS/s 5.3mW Asynchronous ADC in 0.13-μm CMOS / IEEE J. Solid-State Circuits 41 (12) : 2669 ~ 2680
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