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본 논문에서는, 트위스티드 연결구조를 이용한 새로운 저전압 스윙 도미노 로직 회로를 제안한다. 제안된 회로의 출력스윙 범위는 트위스티드 트랜지스터의 사이즈와 출력 캐패시턴스의 크기에 따라 조절가능하다. 제안된 회로를 적용한 리플캐리덧셈기(Ripple Carry Adder)는 도미노 CMOS로직에 비해 전력소비는 37%감소했고 전력·지연 곱(power-delay product)은 43%감소했다.
목차
요약
Abstract
Ⅰ. 서론
Ⅱ. 기존의 도미노 로직
Ⅲ. 제안하는 저전압 스윙 회로
Ⅳ. 제안된 저전압 스윙 도미노 로직
Ⅴ. 실험결과 및 비고
Ⅵ. 결론
REFERENCES
참고문헌 (12)
참고문헌 신청
Z. Liu / 2006 / Robust dynamic node low voltage swing domino logic with multiple threshold voltages / International Symposium on ISQED :30~36
R. Mader / 2003 / Reduced dynamic swing domino logic / Great Lakes Symposium on VLSI :33~36
S. M. Kang / 2003 / CMOS Digital Integrated Circuits: Analysis and Design / McGraw Hill
F. Tang / 2012 / Low power dynamic logic circuit design using a pseudo dynamic buffer / Integration, the VLSI journal 45(4):395~404
I. Hassoune / 2007 / Dynamic differential self-timed logic families for robust and low-power security ICs / Integration, the VLSI journal 40(3):355~364
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