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학술저널
저자정보
Andrés Lopez (Pontificia Universidad Javeriana) Diego Patino (Pontificia Universidad Javeriana) Rafael Diez (Pontificia Universidad Javeriana)
저널정보
전력전자학회 JOURNAL OF POWER ELECTRONICS JOURNAL OF POWER ELECTRONICS Vol.14 No.6
발행연도
2014.11
수록면
1,130 - 1,138 (9page)

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This study analyzes a ladder multilevel converter (double ladder topology) with the use of a new averaging modeling technique. This technique introduces an analytical method to compute for the switching losses and is used to conduct an in-depth analysis of the influence of the switching frequency and parasitic resistance of components on converter efficiency. The obtained results enable the selection of switches and switching frequency to minimize losses. Moreover, simulation results and experimental measurements validate the analytical calculations.

목차

Abstract
I. INTRODUCTION
II. LADDER MULTILEVEL CONVERTER
III. MODELING TECHNIQUES
IV. SWITCHING LOSSES
V. ANALYSIS OF THE CONVERTER
VI. CONCLUSIONS
REFERENCES

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