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논문 기본 정보

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학술저널
저자정보
신훈 (성균관대학교) 김상훈 (성균관대학교) 권기원 (성균관대학교) 전정훈 (성균관대학교)
저널정보
대한전자공학회 전자공학회논문지 전자공학회논문지 제51권 10호
발행연도
2014.10
수록면
87 - 95 (9page)

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이 논문의 연구 히스토리 (2)

2015

다중채널 CIS 인터페이스를 위한 수신기
신훈 반도체디스플레이공 2015.01 학위논문

2014

이중 채널 CIS 인터페이스를 위한 수신기 설계
신훈 ,  김상훈 ,  권기원 외 1명 전자공학회논문지 2014.10 학술저널

초록· 키워드

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본 논문에서는 이중 채널 CIS(CMOS Image Sensor) 인터페이스를 위한 수신기 설계에 대해서 기술한다. 두 채널은 각각 CTLE(Continuous-Time Linear Equalizer)를 포함하며 샘플러, 병렬 변환기 그리고 clocking 회로로 구성되어 있다. Clocking 회로는 PLL, PI, CDR을 포함한다. CDR은 PI 기반이며 OSPD(Over Sampling Phase Detector)와 FSM(Finite State Machine)을 추가하여 빠른 락 소요 시간과 지연 시간, 향상된 jitter tolerance를 갖도록 하였다. CTLE는 3 GHz에서 ?6 dB 손실을 갖는 채널의 ISI(Inter Symbol Interference)를 제거하며 CDR은 8000 ppm 이하의 주파수 오프셋에 대해 1 baud period 이내의 빠른 락 소요 시간을 갖는다. 65 nm CMOS 공정을 이용하여 설계하였으며 eye diagram에서 최소 368 mV의 전압 마진과 0.93 UI의 시간 마진을 갖는다.
#수신기 #CTLE #CDR #OSPD

목차

요약
Abstract
Ⅰ. 서론
Ⅱ. 본론
Ⅲ. 실험
Ⅳ. 결론
REFERENCES

참고문헌 (12)

참고문헌 신청
1. [학술지(정기간행물)] - K. Kim / 2010 / A Multi-Lane MIPI CIS Receiver for Mobile Camera Applications / IEEE Transactions on Consumer Electronics 56 google schola 2. [학술대회논문] - H. Takauchi / 2003 / A CMOS multi-channel 10Gb/s Transceiver / IEEE Dig. Tech. Papers, ISSCC : 72 ~ 73 google schola 3. [학술대회논문] - Y. Liu / 2013 / A 0.1pJ/b 5-10Gb/s Charge-Recycling Stacked Low-Power I/O for On-Chip Signaling in 45nm CMOS SOI / IEEE ISSCC Dig. Tech. Papers : 400 ~ 401 google schola 4. [학술지(정기간행물)] - Seok Kim / / A 5.2-Gb/s Low-Swing Voltage-Mode Transmitter With an AC-/DC-Coupled Equalizer and a Voltage Offset Generator / IEEE Transactions on Circuits and Systems I: Regular Papers 61 (1) google schola 5. [학술지(정기간행물)] - Dongmyung Lee / 2010 / An 8. 5-Gb/s Fully Integrated CMOS Optoelectronic Receiver Using Slope-Detection Adaptive Equalizer / IEEE Journal of Solid-State Circuits 45 : 2861 ~ 2873 google schola

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