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논문 기본 정보
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- 학술저널
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- 저널정보
- 대한전자공학회 IEIE Transactions on Smart Processing & Computing IEIE Transactions on Smart Processing & Computing Vol.4 No.2
- 발행연도
- 2015.4
- 수록면
- 78 - 82 (5page)
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General-purpose graphics processing units (GPGPUs) provide tremendous computational and processing power. Despite the latency hiding mechanism, a GPU architecture requires high memory bandwidth and lower latency between computational units and the memory system. For this reason, the current GPU architecture has private L1 caches in each core and a shared L2 cache to increase performance by reducing memory latency. But in some cases, this CPU-like cache design is not suitable for GPGPUs. In this paper, we analyze detailed cache performance related to GPGPU application characteristics, and suggest technical alternatives for the GPGPU architecture as future work.
목차
Abstract
1. Introduction
2. Backgrounds
3. The Proposed Scheme
4. Detailed Cache Performance Analysis
5. Conclusion
References
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