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시간제약 조건을 고려한 CPLD 기술 매핑 알고리즘 개발 ( Development of Technology Mapping Algorithm for CPLD by Considering Time Constraint )
전자공학회논문지-C
1999 .06
시간제약 조건하에서 모듈 선택 재사용을 이용한 CPLD 저전력 기술 매핑
한국컴퓨터정보학회논문지
2006 .07
시간 제약 조건하에서 면적을 고려한 효율적인 CPLD 기술 매핑 ( An Efficient CPLD Technology Mapping considering Area under Time Constraint )
전자공학회논문지-SD
2001 .01
시간제약 조건하에서 순차 회로를 위한 CPLD 기술 매핑 제어 알고리즘 개발 ( Development of CPLD technology mapping control algorithm for Sequential Circuit under Time Constraint )
전자공학회논문지-T
1999 .12
CPLD를 이용한 2상 스테핑 모터 드라이버의 성능개선
대한전기학회 학술대회 논문집
2003 .11
CPLD를 이용한 2상 스테핑 모터 드라이버의 성능개선
대한전기학회 학술대회 논문집
2003 .11
CPLD칩을 이용한 다채널 가스누출 경보시스템의 설계 및 제작
대한전자공학회 학술대회
1999 .11
CPLD를 이용한 2상 스테핑 모터 드라이버의 성능개선
전기학회논문지 D
2004 .09
OPTIMIZATION ALGORITHMS OF A DATAPATH WITH REVERSIBLE ELEMENTS
JTC-CSCC : Joint Technical Conference on Circuits Systems, Computers and Communications
1992 .01
CPLD를 이용한 2상 스텝모터의 마이크로테스핑 구현
정보 및 제어 논문집
2011 .10
시간제약 조건하에서 순차 회로를 위한 수행시간을 개선한 CPLD 기술 매핑 알고리즘 개발 ( Development of CPLD Technology Mapping Algorithm for Sequential Circuit Improved Run-Time Under Time Constraint )
전자공학회논문지-SD
2000 .04
CPLD를 고려한 RTL 바인딩과 저전력 기술 매핑
한국컴퓨터정보학회논문지
2006 .05
A ROBUST DATAPATH ALLOCATION METHOD FOR REALISTIC SYSTEM DESIGN
ICVC : International Conference on VLSI and CAD
1995 .01
Applying Two-Phased Optimization Algorithm of a Datapath with Reversible Elements
JTC-CSCC : Joint Technical Conference on Circuits Systems, Computers and Communications
1993 .01
YU-RISC의 DATAPATH 설계 ( DATAPATH DESIGN OF YU-RISC )
대한전자공학회 학술대회
1989 .11
FLEX10K 계열에 대한 저전력 CPLD 기술 매핑 알고리즘
대한전자공학회 학술대회
2002 .06
A Flexible Datapath Allocation Method for Architectural Synthesis
대한전자공학회 토론회
1997 .01
A Flexible Datapath Allocation Method for Architectural Synthesis
대한전자공학회 학술대회
1997 .07
시간 제약 조건 안에서 전체 수행 시간을 개선한 CPLD 기술 매핑
한국정보기술학회논문지
2008 .04
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