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대한전자공학회 대한전자공학회 학술대회 대한전자공학회 1990년도 추계종합학술대회 논문집 Vol.13 No.2
발행연도
1990.11
수록면
619 - 622 (4page)

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1993

상위단계 설계 검증을 위한 논리/타이밍 추출 시스템의 설계 ( Design of A Logic/Timing Extraction System for Higher-level Design Verification )
이용재 ,  문인호 ,  황선영 전자공학회논문지-A 1993.02 학술저널

1990

상위 단계에서의 설계 검증을 위한 회로 추출 시스템
이용재 ,  문인호 ,  황선영 대한전자공학회 학술대회 1990.11 학술대회자료
상위 단계에서의 설계 검증을 위한 회로 추출 시스템 ( Circuit Extraction System for Higher-Ievel Design Verification )
이용재 ,  문인호 ,  황선영 대한전자공학회 학술대회 1990.11 학술대회자료

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목차

Abstract
Ⅰ. 서론
Ⅱ. 시스템 개관
Ⅲ. 회로 추출
Ⅳ. 논리 추출및 게이트 단계 지연 모델
Ⅴ. 실험 결과
Ⅵ. 결론
References

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