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논문 기본 정보

자료유형
학술저널
저자정보
양수훈 (인하대학교) 최정훈 (인하대학교) 윤광섭 (인하대학교)
저널정보
대한전자공학회 전자공학회논문지 전자공학회논문지 제52권 5호
발행연도
2015.5
수록면
51 - 57 (7page)

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이 논문의 연구 히스토리 (3)

2015

2개의 증폭기를 이용한 가변 구조 형의 4차 델타 시그마 변조기
양수훈 ,  최정훈 ,  윤광섭 전자공학회논문지 2015.05 학술저널
2개의 증폭기를 이용한 가변 구조 형의 4차 델타 시그마 변조기
양수훈 일반 2015.01 학위논문

2014

약반전 증폭기를 이용한 3차 ΣΔ변조기 설계
양수훈 ,  최정훈 ,  윤광섭 대한전자공학회 학술대회 2014.06 학술대회자료

초록· 키워드

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본 논문에서는 생체 신호 처리를 위한 14비트 이상의 고 해상도를 갖는 A/D 변환기 설계를 위하여 공급 전압이 1.8V인 CMOS 델타-시그마 변조기를 설계하였다. 본 논문에서 제안하는 4차 델타 시그마 변환기는 타임 인터리빙 기술을 이용하여 회로를 시간에 따라 재구성해 연산증폭기를 재사용하는 구조를 통해 차수에 따라 4개의 연산증폭기가 필요한 회로를 2개의 연산증폭기 만으로 구동 시켰다. 또한 스위치드 커패시터 적분기 구조상의 특징인 샘플링 시간과 적분 시간의 동작에 따라 샘플링 커패시터의 크기를 조절함으로서 저항 성분으로부터 발생하는 열잡음인 KT/C 잡음을 감소시킬 수 있는 회로를 제안하였다. 제안한 델타-시그마 변조기는 Magna 0.18㎛ CMOS n-well 1 폴리 6메탈 공정을 이용하여 제작되었으며 제작된 칩의 측정 결과 전력소모는 1.8V 전원 전압에서 828㎼이고 샘플링 및 입력 주파수가 256㎑, 1㎑일 때 최대 SNDR은 75.7㏈, DR은 81.3㏈로 측정되었다. KT/C 잡음 저감 회로가 적용되지 않은 회로에서는 최대 SNDR이 72.1㏈ 로 측정되어 KT/C 잡음 저감 회로가 적용되었을 때 약 3㏈정도의 성능 향상을 나타내었다. 회로의 FOM은 41pJ/step 과 142㏈로 계산되었다.
#Bio signal #ΣΔmodulator #low power #reuse #KT/C noise

목차

요약
Abstract
Ⅰ. 서론
Ⅱ. 제안된 회로 설계
Ⅲ. 측정 결과
Ⅳ. 결론
REFERENCES

참고문헌 (8)

참고문헌 신청
1. [학술지(정기간행물)] - Zhenglin Yang / 2012 / A 0.5-V 35-μW 85-dB DR Double-Sampled ΔΣModulator for Audio Applications / JSSC 47 : 722 ~ 735 google schola 2. [학술지(정기간행물)] - H. D. Roh / 2010 / A 0.6-V Delta?Sigma Modulator With Subthreshold-Leakage Suppression Switches / Circuits and Systems II 56 : 825 ~ 829 google schola 3. [학술지(정기간행물)] - Bonizzoni / 2010 / Third-order ΣΔ modulator with 61-dB SNR and 6-MHz bandwidth consuming 6 mW / analg Integr.Circuits Signal Process 66 (3) : 381 ~ 388 google schola 4. [학술지(정기간행물)] - Pena-Perez, A / / A 88-dB DR, 84-dB SNDR Very Low-Power Single Op-Amp Third-Order ΣΔ Modulator / JSSC 47 : 2107 ~ 2118 google schola 5. [단행본] - R. Schreier / 2005 / Understanding Delta-Sigma Data Converters / Wiley-IEEE Press google schola

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