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논문 기본 정보
- 자료유형
- 학술대회자료
- 저자정보
- 발행연도
- 2016.6
- 수록면
- 174 - 178 (5page)
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Network on Chips (NoCs) are proposed to solve communication bandwidth limitation in modern Multi-Processors System on Chip (MPSoC) systems. Researchers (prove) relies their proposed ideas using modeling and simulation to evaluate the performance of their novel ideas. In this paper, we present a Verilog-HDL based simulator for NoCs. It considered as a cycle-accurate simulator to simulate the real environment of NoCs. It has a set of parameters that can be modify for a determined test. Also, it has the capability to add and remove any of network or router components.
목차
Abstract
I. INTRODUCTION
II. BACKGROUND
III. DESIGN OF VERILOG-HDL BASED SIMULATION PLATFORM
IV. RESULTS AND DISCUSSION
V. CONCLUSION AND FUTURE WORK
REFERENCES
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