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논문 기본 정보

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학술저널
저자정보
Wang Weizheng (Changsha University of Science and Technology) Wang JinCheng (Changsha University of Science and Technology) Cai Shuo (Changsha University of Science and Technology) Su Wei (Nanjing Audit University) Xiang Lingyun (Changsha University of Science and Technology)
저널정보
대한전자공학회 JOURNAL OF SEMICONDUCTOR TECHNOLOGY AND SCIENCE Journal of Semiconductor Technology and Science Vol.16 No.4
발행연도
2016.8
수록면
463 - 469 (7page)

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This paper presents a compression-friendly low power test scheme in EDT environment. The proposed approach exploits scan slices reusing to reduce the switching activity during shifting for test scheme based on linear decompressor. To avoid the impact on encoding efficiency from resulting control data, a counter is utilized to generate control signals. Experimental results obtained for some larger ISCAS’89 and ITC’99 benchmark circuits illustrate that the proposed test application scheme can improve significantly the encoding efficiency of linear decompressor.

목차

Abstract
Ⅰ. INTRODUCTION
Ⅱ. BACKGROUND AND MOTIVATION
Ⅲ. COMPRESSION-FRIENDLY LOW POWER TEST APPLICATION SCHEME
Ⅳ. EXPERIMENTAL RESULTS
Ⅴ. CONCLUSIONS
REFERENCES

참고문헌 (24)

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