타일 기반 그래픽 파이프라인 구조를 사용한 SIMT 구조 GP-GPU 설계

김도현; 김치용

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자료유형: 학술저널

저자정보: 김도현 김치용

저널정보: 한국전기전자학회 전기전자학회논문지 전기전자학회논문지 제20권 제1호

발행연도: 2016.3

수록면: 75 - 81 (7page)

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본 논문은 SIMT(Single Instruction Multi Thread)구조 GP-GPU(General Purpose Graphic Processing Unit)에서 그래픽 어플리케이션 성능을 향상시키기 위해 타일 기반 그래픽 파이프라인 구조를 제안한다. 타일 기반 그래픽 파이프라인 구조는 병렬적으로 Rasterization 단계를 처리하고, 불필요한 그래픽 처리 연산은 수행하지 않는다. SIMT구조를 통해 대용량 데이터를 병렬로 처리하여 연산 성능을 향상시켰고, 이는 3D 그래픽 파이프라인 처리의 성능을 향상하였다. 제안하는 구조를 통해 3D 그래픽 어플리케이션을 처리할 때 3D 모델을 구성하는 정점 데이터가 많아 질수록 높은 효율을 보인다. 제안하는 구조는 'RAMP'와 기존의 선행 연구를 비교하여 약 1.18배에서 최대 3배까지의 처리 성능 향상을 확인하였다.

#Hierarchy structure #Inside outside test #Rasterization #SIMT #tile-based graphic pipeline

참고문헌 (8)

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[학술대회논문] - Laszlo, E. / 2014 / Methods to utilize SIMT and SIMD instruction level parallelism in tridiagonal solvers / Cellular Nanoscale Networks and their Applications (CNNA), 2014 14th International Workshop on

[학술대회논문] - Pinto, C. / 2011 / GPGPU-Accelerated Parallel and Fast Simulation of Thousand-Core Platforms, Cluster / Cloud and Grid Computing (CCGrid), 2011 11th IEEE/ACM International Symposium on : 53 ~ 62

[학위논문] - W.F.P.W. Burgers / 2005 / Tile-Based Rendering / Master / Technische Universiteit Eindhoven

[학위논문] - Ramchan Woo / 2004 / Design and Implementation of Low-Power 3D Graphics SoC for Mobile Multimedia Applications / KAIST

[학위논문] - Jang-seo Ku / 2013 / Design of a Rasterizer based on Parallel Processing Interpolation Algorithm for a Mobile GPU / The Graduate School of Seokyeong University

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