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논문 기본 정보

자료유형
학술저널
저자정보
장정근 (아주대학교) 선우명훈 (아주대학교)
저널정보
대한전자공학회 전자공학회논문지 전자공학회논문지 제54권 제7호 (통권 제476호)
발행연도
2017.7
수록면
29 - 35 (7page)

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본 논문에서는 고속 데이터 전송을 위해 orthogonal frequency division multiplexing (OFDM) 시스템에 적용 가능한 고속 fast Fourier transform (FFT) 프로세서를 제안하였다. 제안하는 FFT 프로제서는 높은 처리율을 만족하기 위해 mixed-radix 알고리즘과 8개의 병렬 경로를 가지는 multipath delay commutator (MDC) 파이프라인 구조를 채택하였다. 하드웨어 복잡도를 줄이기 위해서 새로운 스케줄링 기법들을 적용하여 twiddle factor 연산을 위한 read-only memories (ROM)의 크기를 줄이는 구조와 복소 상수 곱셈기의 수를 줄이는 구조를 제안한다. 제안하는 구조는 지연 소자와 연산 사이클의 증가 없이 하드웨어 복잡도를 줄일 수 있다. 또한, IEEE 802.11 ac/ad와 같은 고속 OFDM 시스템을 위해 64/128/256/512-포인트 FFT 연산이 가능하다. 제안하는 FFT 프로세서는 Verilog-HDL로 모델링하여 Samsung 65nm 공정 라이브러리로 합성하여 0.36mm2의 면적과 330MHz의 동작 주파수에서 2.64 GSample/s를 보이고 있다.

목차

요약
Abstract
Ⅰ. 서론
Ⅱ. 기존 FFT 프로세서
Ⅲ. 제안하는 FFT 프로세서
Ⅳ. 실험
Ⅴ. 결론
REFERENCES

참고문헌 (10)

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