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저자정보
정동민 (Korea Aerospace University) 노윤석 (Korea Aerospace University) 손한나 (Korea Aerospace University) 정용철 (Korea Aerospace University) 정윤호 (Korea Aerospace University)
저널정보
한국전기전자학회 전기전자학회논문지 전기전자학회논문지 제24권 제3호
발행연도
2020.9
수록면
797 - 802 (6page)

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본 논문에서는 base-4 시스토릭 어레이 FFT 프로세서에서 사용되는 여러 메모리를 하나의 메모리로 공유함으로써 기존보다 작은 메모리 면적의 FFT 프로세서의 설계 및 구현 결과를 제시한다. 메모리를 공유하여 면적이 줄어드는 장점이 생겼으며, 데이터의 입출력이 하나의 메모리에서 진행되므로 데이터의 흐름이 단순해졌다. 제시한 FFT 프로세서를 FPGA 디바이스 상에서 구현 및 검증하였으며, 구현 결과 4096-point FFT 기준 51,855개의 CLB LUT, 29,712개의 CLB registers, 8개의 block RAM tile과 450개의 DSP로 구현되었고, 최대 동작 주파수는 150MHz 인 것을 확인했으며 특히, 기존 base-4 시스토릭 어레이 구조 대비 메모리 면적이 65% 감소 가능함을 확인하였다.

목차

Abstract
요약
Ⅰ. 서론
Ⅱ. Base-4 기반의 시스토릭 어레이 FFT 알고리즘
Ⅲ. 제안된 FFT 프로세서의 하드웨어 구조
Ⅳ. 제안된 FFT 프로세서 설계 및 구현
Ⅴ. 결론
References

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