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저자정보
문윤정 (SK hynix) 이호균 (SK hynix) 주영표 (SK hynix)
저널정보
대한전자공학회 대한전자공학회 학술대회 2017년도 대한전자공학회 정기총회 및 추계학술대회
발행연도
2017.11
수록면
109 - 112 (4page)

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Recently, the need for heterogeneous memory is emerging to overcome the limitations of memory technology in computer systems. In this study, we implemented an environment to emulate a heterogeneous memory system including a DRAM cache and analyzed its performance. The accuracy of the proposed methodology is validated by the simulation and we show that the average error rate of IPC (Instruction Per Cycle) is 2%. We got benchmark performance result in various heterogeneous memory system configurations by adjusting memory latency and bandwidth according to new memory characteristics.

목차

Abstract
I. 서론
II. 본론
III. 구현
IV. 결론 및 향후 연구 방향
참고문헌

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