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논문 기본 정보
- 자료유형
- 학술저널
- 저자정보
- 저널정보
- 대한전자공학회 JOURNAL OF SEMICONDUCTOR TECHNOLOGY AND SCIENCE Journal of Semiconductor Technology and Science Vol.17 No.6
- 발행연도
- 2017.12
- 수록면
- 845 - 853 (9page)
- DOI
- 10.5573/JSTS.2017.17.6.845
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This paper presents an area-efficient half-row pipelined layered low-density parity check (LDPC) decoder architecture for IEEE 802.11ad applications. The proposed decoder achieves a good tradeoff between throughput and area because of its ability to overcome the low-throughput bottleneck in conventional half-row decoders and the high-complexity bottleneck in fully parallel decoders. Synthesis results using TSMC 40 nm CMOS technology shows much better throughput at 10.84 Gbps and superior area efficiency, compared to previously reported LDPC decoders.
목차
Abstract
I. INTRODUCTION
II. LAYERED LDPC DECODING ALGORITHM
III. PROPOSED HALF-ROW PIPELINED LAYERED LDPC DECODER ARCHITECTURE
IV. ANALYSIS AND COMPARISON RESULTS
V. CONCLUSIONS
REFERENCES
참고문헌 (21)
참고문헌 신청
R. G. Gallager, Low-Density Parity-Check Codes, MIT Press, Cambridge, MA, 1963.
IEEE 802.11ad Wireless Lan: PHY/MAC Complete Proposal Specification, May 2010.
M. Mansour, N. Shanbhag, “High-throughput LDPC decoders,” IEEE Trans. VLSI Syst., vol. 11, no. 6, pp. 976?996, Dec. 2003.
S. Kim, G. E. Sobelman, and H. Lee, “A Reduced- Complexity Architecture for LDPC Layered Decoding Schemes,” IEEE Transactions on VLSI Systems, vol. 19, no. 6, pp. 1099-1103, June 2011.
S.-I. Hwang, H. Lee, “Block-Circulant RS-LDPC Code: Code Construction and Efficient Decoder Design,” IEEE Transactions on VLSI Systems, vol.21, no. 7, pp. 1337-1341, July 2013.
IEEE 802.11ad Wireless Lan: PHY/MAC Complete Proposal Specification, May 2010.
M. Mansour, N. Shanbhag, “High-throughput LDPC decoders,” IEEE Trans. VLSI Syst., vol. 11, no. 6, pp. 976?996, Dec. 2003.
S. Kim, G. E. Sobelman, and H. Lee, “A Reduced- Complexity Architecture for LDPC Layered Decoding Schemes,” IEEE Transactions on VLSI Systems, vol. 19, no. 6, pp. 1099-1103, June 2011.
S.-I. Hwang, H. Lee, “Block-Circulant RS-LDPC Code: Code Construction and Efficient Decoder Design,” IEEE Transactions on VLSI Systems, vol.21, no. 7, pp. 1337-1341, July 2013.
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