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논문 기본 정보
- 자료유형
- 학술저널
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- 발행연도
- 2020.3
- 수록면
- 1 - 9 (9page)
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본 논문에서는 MLC STT-MRAM 캐시 메모리의 쓰기 동작 성능을 향상시킬 수 있는 효율적인 쓰기 기법을 제안한다. 제안하는 기법의 핵심 아이디어는 MLC STT-MRAM에 저장된 캐시 블록이 데드 블록 (Dead block)일 경우 쓰기 동작을 빠르게 수행하는 것이다. 이러한 빠른 쓰기 동작은 MLC STT-MRAM에 저장된 캐시 블록을 제거할 수 있지만, 제거된 블록이 앞으로 사용되지 않는 데드 블록일 경우에는 시스템 성능에 미치는 영향이 매우 작다. 메모리 시뮬레이터를 사용한 실험 평가를 통해 본 논문에서 제안하는 쓰기 기법이 MLC STT-MRAM 캐시의 성능을 평균 17% 향상시킬 수 있음을 보인다.
목차
[Abstract]
[요약]
I. Introduction
II. Background
III. The Proposed Scheme
IV. Experiments
V. Conclusions
REFERENCES
참고문헌 (18)
참고문헌 신청
Suock Chung / 2010 / Fully integrated 54nm STT-RAM with the smallest bit cell dimension for high density memory application / Proceedings of 2010 International Electron Devices Meeting :12.7.1~12.7.4
T. Ishigaki / 2010 / A multi-level-cell spin-transfer torque memory with series-stacked magnetotunnel junctions / Proceedings of 2010 Symposium on VLSI Technology :47~48
Lei Jiang / 2012 / Constructing large and fast multi-level cell STT-MRAM based cache for embedded processors / Proceedings of the 49th Annual Design Automation Conference :907~912
Y. Chen / 2010 / Access scheme of Multi-Level Cell Spin-Transfer Torque Random Access Memory and its optimization / Proceedings of 53rd IEEE International Midwest Symposium on Circuits and Systems :1109~1112
X. Bi / 2013 / Unleashing the potential of MLC STT-RAM caches / Proceedings of 2013 IEEE/ACM International Conference on Computer-Aided Design (ICCAD) :429~436
T. Ishigaki / 2010 / A multi-level-cell spin-transfer torque memory with series-stacked magnetotunnel junctions / Proceedings of 2010 Symposium on VLSI Technology :47~48
Lei Jiang / 2012 / Constructing large and fast multi-level cell STT-MRAM based cache for embedded processors / Proceedings of the 49th Annual Design Automation Conference :907~912
Y. Chen / 2010 / Access scheme of Multi-Level Cell Spin-Transfer Torque Random Access Memory and its optimization / Proceedings of 53rd IEEE International Midwest Symposium on Circuits and Systems :1109~1112
X. Bi / 2013 / Unleashing the potential of MLC STT-RAM caches / Proceedings of 2013 IEEE/ACM International Conference on Computer-Aided Design (ICCAD) :429~436
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