CPU Interconnects의 진화

정병권

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자료유형: 학술대회자료

저자정보: 정병권 (한국전자통신연구원)

저널정보: 대한전자공학회 대한전자공학회 학술대회 2021년도 대한전자공학회 추계학술대회 논문집

발행연도: 2021.11

수록면: 729 - 733 (5page)

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Recently, high-performance computing systems are required for big data processing such as AI, image classification, voice recognition, medical diagnosis, and autonomous driving. Accordingly, collection, storage, processing, and analysis of big data in search engines, finance, and telecommunications, as well as handling multimedia big data, which has been previously easy to access and utilize, are increasingly required. In recent years, the size and type of big data that can be digitized and accepted are expanding further with the advancement of computing technology due to the rapid development of storage and memory semiconductor technology. As such faster data processing and a larger and more efficient memory approach are required, such data processing requires support for high bandwidth connecting processors and devices inside computers and connecting devices to devices.
Currently, most I/O devices such as CPUs and GPUs and accelerators are connected through PCIe protocols, resulting in relatively low bandwidth and high delays, memory sharing and consistency problems between I/O and CPU.
The computer industry has been seeking more efficient protocols for computer connections to expand the connection of processors and devices inside computers since 2015. In this paper, we will deal with the evolution of the architecture surrounding the CPU.

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