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논문 기본 정보
- 자료유형
- 학술저널
- 저자정보
- 발행연도
- 2022.4
- 수록면
- 269 - 277 (9page)
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본 논문에서는 칩 인덕터에 대한 향상된 등가 모델링 기법을 이용하여, 칩 소자의 임피던스 특성을 BPF 회로설계에 적용하였다. 향상된 등가 모델링 기법은 칩 내부 소자 및 허용오차, 기생 소자를 포함하여 임피던스 특성을 분석할 수 있으며, 향상된 등가 모델링을 응용하여 회로설계에 요구되는 칩 소자값을 충족시킬 수 있다. 이를 2차 체비셰프 프로토타입을 갖는 5G sub-6 GHz 대역 통과 필터 설계에 이를 적용하였으며, 통과대역 중심주파수에서 측정된 삽입손실은 제조사별 각각 2.1 dB, 1.1 dB이었다. 동일한 등가회로를 이용하는 기존 연구에 비해 회로 크기가 78 % 감소된 소형화 설계가 가능하였다.
목차
요약
Abstract
Ⅰ. 서론
Ⅱ. 본론
Ⅲ. 5G Sub-6GHz BPF 측정 및 비교
Ⅳ. 결론
References
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