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논문 기본 정보
- 자료유형
- 학술대회자료
- 저자정보
- 발행연도
- 2024.6
- 수록면
- 958 - 961 (4page)
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This paper proposes a parallel TF (Twiddle Factor) generator that produces p TFs simultaneously to enhance the efficiency of NTT (Number Theoretic Transform) hardware. With the rise of cloud computing, the importance of Fully Homomorphic Encryption (FHE) has grown, as it allows unlimited operations on encrypted data, ensuring secure and reliable data processing. Implementing NTT is crucial for polynomial multiplication in FHE hardware, but the increasing number of TFs with more NTT inputs extends initialization time. To address this, we introduce a parallel TF generator. Evaluations on a Kintex Ultrascale KU040 board using Xilinx Vivado 2021.2 show that our TF generator can be optimized for hardware resources, comparing ROM-based TF storage methods.
목차
Abstract
Ⅰ. Introduction
Ⅱ. Background
Ⅲ. Proposed Design
Ⅳ. Experimental Results
Ⅴ. Conclusion
참고문헌
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