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논문 기본 정보
- 자료유형
- 학술대회자료
- 저자정보
- 발행연도
- 2024.6
- 수록면
- 996 - 999 (4page)
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In this paper, we present a 4-bit 30 MS/s, 2-times time-domain interpolation flash ADC leveraging a power-efficient dynamic comparator. This comparator integrates a complementary dynamic amplifier (CDA) functioning as a voltageto-time converter and dynamic latches to enhance the power efficiency of the interpolating flash ADC. Implemented in a 500 nm CMOS process with 2-poly and 3-metal layers, the proposed ADC demonstrates a 16% improvement in power efficiency compared to the interpolating flash ADC employing a conventional dynamic amplifier, thanks to the utilization of the CDA.
목차
Abstract
Ⅰ. INSTRODUCTION
Ⅱ. DYNAMIC AMPLIFIER
Ⅲ. MEASUREMENT RESULT
Ⅳ. Conclusions
Reference
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