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논문 기본 정보
- 자료유형
- 학술대회자료
- 저자정보
- 발행연도
- 2024.11
- 수록면
- 258 - 262 (5page)
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In this paper, the implementation of SRAM-based all-digital in-memory computing (IMC) macro is introduced. Since IMC macro can reduce the data movement and provide massive parallel operation, the power consumption can be reduced and the memory bottleneck in Von Neumann-architecture based can be overcome. The introduced IMC is implemented in a 28-nm process from high-level language design. The implemented IMC with 12T-based SRAM provides 4-bit matrix multiplication at 10MHz clock under 1V supply. As a result, 33TOPS/W is achieved at pre-layout simulation.
목차
Abstract
I. 서론
II. 본론
III. 구현
Ⅳ. 결론 및 향후 연구 방향
참고문헌
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