RISC-V Core의 연산 성능 향상을 위한 Offloading FPU 및 DMA 시스템 설계

박나영; 송서빈; 김상협; 최정욱

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자료유형: 학술대회자료

저자정보: 박나영 (한양대학교) 송서빈 (한양대학교) 김상협 (한양대학교) 최정욱 (한양대학교)

저널정보: 대한전자공학회 대한전자공학회 학술대회 2024년도 대한전자공학회 추계학술대회 논문집

발행연도: 2024.11

수록면: 469 - 472 (4page)

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As AI models scale, the overhead from MAC (Multiply-Accumulate) operations has increased, highlighting the need for efficient accelerators.
In this paper, we designed a system by integrating an DMA and FPU with the RISC-V Core to enhance memory data transfer efficiency. Comparing the utilization of the Core FPU with the offloading FPU and DMA demonstrates that the system improves computational efficiency, especially in large-scale data processing tasks.

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