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본 논문은 OFDM (Orthogonal Frequency-Division Multiplexing) 시스템을 2K/4K/8K-point 복소 FFT (Fast Fourier Transform) 프로세서의 구조와 그 구현방법을 제안한다. 제안하는 프로세서의 구조는 긴 길이의 DFT를 짧은 길이의 다차원 DFT로 분할하기 위하여 쿨리-투키 알고리듬에 기반 한다. 전치 메모리, 셔플 메모리, 멜모리 합성 방법은 다차원 변환을 위한 메모리의 능률적 조작을 위해 사용한다. Booth 알고리듬과 CORDIC (COordinate Rotation DIgital Computer) 프로세서는 각 차원에서 트위들 팩터 곱셈을 위해 사용한다. 또한, CORDIC 프로세서에는 트위들 팩터를 저장하기 위해 필요한 ROM의 사용을 막기 위해 트위들 팩터 발생 방법을 제안한다. 전체 2K/4K/8K FFT 프로세서는 600,000 게이트를 사용하며, 1.8 ?? ,0.18 ㎛ CMOS를 이용해 구현한다. 제안하는 프로세서는 8K-point FFT를 273 ㎲마다, 2K-point를 68.26㎲마다 수행할 수 있으며, SNR은 DVB-T의 OFDM을 위해 충분한 48dB를 넘는다.
목차
요약
ABSTRACT
Ⅰ.Introduction
Ⅱ.Basic Building Block for the Cooley-Tukey Algorithm
Ⅲ.Overall Architecture
Ⅳ.Complex Multiplier
Ⅴ.Memory Control
Ⅵ.Chip Features
Ⅶ.Conclusions
REFERENCES
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