Data Weighted Averaging을 이용한 3차 멀티비트 Sigma-Delta 변조기

김선홍; 최석우; 조성익; 김동용

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자료유형: 학술저널

저자정보: 김선홍 최석우 조성익 김동용

저널정보: 대한전자공학회 전자공학회논문지-SD 전자공학회논문지 SD편 제41권 제9호

발행연도: 2004.9

수록면: 107 - 114 (8page)

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본 논문에서는 DWA(Data Weighted Averaging) 방식의 sigma-delta 변조기에서 피드백 지연시간을 최적화 할 수 있는 DWA 구조의 블록도 및 타이밍도를 제안한다. 변조기 설계를 위하여 MATLAB 모델링으로 적분기의 최적 계수를 설정한 후 변조기의 비이상성을 고려하여 완전 차동 SC 적분기, 피드백 DAC. 9-레벨 양자화기, DWA를 설계하였다. 각 블록을 이용하여 실현된 3차 멀티비트 sigma-delta 변조기는 0.35㎛ CMOS 공정으로 칩으로 제작하였고, 동작 특성은 12vp-p 825kHz의 입력 신호, 샘플링 주파수 52.8MHz에서 75dB의 SNR과 74dB의 DR을 가진다.

참고문헌 (7)

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[학술지(정기간행물)] - I. Galton / jan.2002. / Delta-Sigma Data Conversion in Wireless Transceivers 50 (1) : 302 ~ 316

[학술지(정기간행물)] - A. Marques / Sep.1998 / Optimal Parameters for ΔΣ Modulator Topologies 45 (9) : 1232 ~ 1241

[학술지(정기간행물)] - B. P. Brandt / Dec.1999 / A 50-MHz Multibit Sigma-Delta Modulator for 12-b 2-MHz A/D Conversion 26 : 1746 ~ 1756

[학술지(정기간행물)] - B. W. Cho / Jun.2000 / A Second-Order Sigma-Delta Modula -tor with a Gain Scaling of ADC and a Simple Multibit DAC E83-A (6)

[학술지(정기간행물)] - J. Grilo, / / A 12-mW ADC Delta-Sigma Modulator With 80dB of Dynamic Range Integrated in a Single- Chip Bluetooth Transceiver sc-37 : 271 ~ 278

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