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대한전자공학회 전자공학회논문지-SD 전자공학회논문지 SD편 제41권 제11호
발행연도
2004.11
수록면
87 - 95 (9page)

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본 논문에서는 SoC 테스트를 위한 새로운 테스트 데이터 압축 방법을 제안한다. 제안하는 압축 방법은 테스트 데이터 압축을 위해 압축율과 하드웨어 오버헤드를 고려하여 최대 효율을 가지도록 하는데 기초하고 있다. 압축율을 높이기 위해서 본 논문에서는 IR기법과 MSCIR 압축 코드를 사용하며, 뿐만 아니라 이를 위한 사전 작업인 새로운 맵핑 기법 및 테스트 패턴 순서 재조합 방법을 제안한다. 기존의 연구와는 달리 CSR 구조를 사용하지 않고 원래의 테스트 데이터를 사용하여 압축하는 방법을 사용한다. 이렇게 함으로써 제안하는 압축 방법은 기존의 연구에 비해 훨씬 높은 압축율을 가지며 낮은 하드웨어 오버 헤드의 디컴프레션 구조를 가진다. ISCAS ’89 벤치 회로에 대한 기존의 연구와의 비교로서 그 결과를 알 수 있다.

목차

요약

Abstract

Ⅰ. 서론

Ⅱ. IR (Input Reduction) 기법

Ⅲ. 제안하는 압축 방법

Ⅳ. 실험 결과

Ⅴ. 결론

참고문헌

저자소개

참고문헌 (16)

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[학술지(정기간행물)] - Y. Zorian / 2000. / Test of Future System on Chips : 392 ~ 400 google schola [학술지(정기간행물)] - / 1999 / The International Technology Roadmap for Semiconductors google schola [학술지(정기간행물)] - I. Hamzaoglu / 1998. / Test set compac -tion algorithms for combinational circuits : 283 ~ 289 google schola [학술지(정기간행물)] - I. Pormeranz / 1993. / A method to generate compact test set for combinational circuits IEEE Trans -actions on Computer Aided Design 12 : 1040 ~ 1049 google schola [학술지(정기간행물)] - M. Ishida, / 1998. / Compact: A hybrid method for compressing test data : 62 ~ 69 google schola

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