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이용수
요약
Abstract
1. 서론
2. 관련 연구
3. Exhaustive 테스트 패턴을 이용한 병렬 처리
4. Exhaustive 테스트 패턴을 이용한 병렬 테스트 구현
5. 결론 및 향후 연구 과제
참고문헌
저자소개
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관계행열을 이용한 회로의 의사-전체검사 패턴 생성 ( Generation of Pseudo-exhaustive Test Patterns Using D ( N ) for the Circuit Under Test )
전자공학회논문지
1990 .07
반도체 집적회로의 고장 가능성에 기초한 테스트 패턴 생성
대한전자공학회 학술대회
1995 .06
반도체 집적회로의 고장 가능성에 기초한 테스트 패턴 생성 ( Test Pattern Generation on the basis of Fault Probability in Semiconductor Integrated Circuits )
대한전자공학회 학술대회
1995 .07
디스플레이 테스트를 위한 패턴 생성 회로 설계
대한전자공학회 학술대회
2003 .07
상위 수준 설계에서의 테스트패턴 생성 ( High Level Test Generation )
대한전자공학회 학술대회
1998 .11
상위 수준 설계에서의 테스트패턴 생성
대한전자공학회 학술대회
1998 .11
패턴 집단 생성 방식을 사용한 내장형 자체 테스트 기법
전자공학회논문지-SD
2002 .07
행렬 기반으로 구현된 자동 테스트 패턴 생성
대한전자공학회 학술대회
1994 .07
행렬 기반으로 구현된 자동 테스트 패턴 생성 ( An Implementation on the Automatic Test Pattern Generation With the Based Matrix )
대한전자공학회 학술대회
1994 .07
Pseudo-exhaustive Test를 위한 회로 분할에 관한 연구 ( A Study on the Circuit Partitioning for Pseudo-exhaustive Test )
대한전자공학회 학술대회
1995 .01
테스트패턴 생성을 위한 신경회로망의 설계 ( Implementation of Neural Network for Test Pattern Generation )
대한전자공학회 학술대회
1991 .11
패턴을 이용한 실용적인 실험값 생성에 대한 연구
한국정보과학회 학술발표논문집
2012 .06
SoC환경에서의 저전력 테스트를 고려한 테스트 패턴 압축에 대한 효율적인 알고리즘
전자공학회논문지-SD
2004 .09
A New Pseudo-Exhaustive Testing Using t-distribution
ITC-CSCC :International Technical Conference on Circuits Systems, Computers and Communications
1997 .01
조합 논리 회로의 기능적 출력 검증을 위한 의사-전체검사 패턴 생성에 관한 연구 ( A Study on the Pseudo-Exhaustive Test Pattern Generation for the Functional Output Verification of Combinational Logic Circuits )
대한전자공학회 학술대회
1990 .01
디지탈 논리회로에 대한 효율적인 테스트 패턴 생성 알고리듬 ( An Efficient Test Generation Algorithm for Digital Logic Circuits )
전자공학회논문지-A
1991 .02
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