SoC 플랫폼에서 시스템 버스의 모델링 및 해석

조영신; 이제훈; 조경록

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자료유형: 학술저널

저자정보: 조영신 이제훈 조경록

저널정보: 대한전자공학회 전자공학회논문지-SD 전자공학회논문지 SD편 제42권 제12호

발행연도: 2005.12

수록면: 35 - 44 (10page)

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SoC 설계 기술의 발달로 하나의 칩 내에 집적되는 시스템이 다양한 기능을 수행함에 따라 높은 버스 대역폭이 요구되고 있으며, 시스템 버스의 성능이 전체 시스템의 성능에 큰 영향을 미치고 있다. 본 논문은 다중 마스터를 갖는 SoC용 플랫폼의 효율적인 버스 자원 관리를 위해 다층 구조를 갖는 공유 버스의 레이턴시 모델을 제시하였다. 제안된 모델을 이용하여 시스템의 특성과 레이어 및 마스터 수의 증가에 따른 버스의 레이턴시를 분석하였다. 레이턴시 모델을 통해 유도된 버스 처리량과 MPEG, USB2.0과 같은 IP를 포함하는 SoC플랫폼이 필요로 하는 처리량과의 비교를 통해 IP 수에 적합한 버스 레이어를 정량화하여 특정 SoC플랫폼에 최적인 멀티레이어 구조를 도출하였다. 끝으로 제안된 모델의 레이턴시와 MaxSim을 이용한 버스의 레이턴시를 비교하였을 때, 싱글레이어와 멀티레이어에서 각각 96%와 85% 이상의 정확도를 보였다.

참고문헌 (11)

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[학술지(정기간행물)] - W.O. Cesario / Dec.2002. / Design & Test of Computers 19 (6) : 52 ~ 63

[학술지(정기간행물)] - K. Keutzer / Dec.2000. / orthogonalization of concerns and platform-based design 19 : 1523 ~ 1543

[학술지(정기간행물)] - Li Li / oct.2003. / A new platform-based orthogonal SoC design methodology 1 (3) : 428 ~ 432

[학술지(정기간행물)] - Kyeong Keol Ryu / Sept.2001. / A comparison of five different multiprocessor SoC bus architectures : 202 ~ 209

[학술지(정기간행물)] - 천익재 / 2003년9월 / SoC를 위한 통신망 설계 동향 30 (5) : 992 ~ 1001

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