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논문 기본 정보
- 자료유형
- 학술저널
- 저자정보
- 발행연도
- 2009.1
- 수록면
- 63 - 67 (5page)
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전하 펌프의 전류 부정합은 위상 고정 루프의 주파수 성분에 기준 스퍼를 발생시킴으로써 특성을 떨어뜨리게 한다. 전류 부정합은 캐스코드 출력단과 같이 전하 펌프의 출력 저항을 높여줌으로써 감소시킬 수 있다. 그러나 공급 전압이 낮아짐에 따라 트랜지스터를 쌓기 힘들어지게 된다. 본 논문에서는 전류 부정합을 줄이기 위한 새로운 방법을 제안하였다. 제안한 방법은 출력 단의 채널 길이 변조에 의한 전류 변화를 피드포워드 방식으로 보상해 주는 것이다. 새로운 방법에 대한 시뮬레이션은 CMOS 0.18㎛ 공정을 이용하였다.
목차
요약
Abstract
Ⅰ. 서론
Ⅱ. 피드포워드 방식의 동작 원리
Ⅲ. 피드포워드 방식을 구현한 방법
Ⅳ. 피드포워드 방식을 적용하여 개선한 전하 펌프
Ⅴ. 결론
참고문헌
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1. [학술지(정기간행물)] - H. Arora / 2005 / Enhanced phase noise modeling of fractional-N frequency synthesizers / IEEE Trans. Circuits Syst. I, Reg. Papers 52 (2) : 379 ~ 395
2. [학술지(정기간행물)] - W. Rhee / 2000 / A 1.1-GHz CMOS fractional-N frequency synthesizer with a 3-b third-order △Σ modulator / IEEE J. Solid-State Circuits 35 (10) : 1453 ~ 1460
3. [학술지(정기간행물)] - Young-Shig Choi / 2006 / Gain- boosting charge pump for current matching in phase-locked loop / IEEE Trans. Circuits Syst. II, Express Briefs 53 (10) : 1022 ~ 1025
4. [학술지(정기간행물)] - Jae-Shin Lee / 2000 / Charge pump with perfect current matching characteristics in phase-locked loops / Electronics Letters 36 : 1907 ~ 1908
5. [보고서] - A. Waizman / 1994 / A delay line loop for frequency synthesis of deskewed clock
2. [학술지(정기간행물)] - W. Rhee / 2000 / A 1.1-GHz CMOS fractional-N frequency synthesizer with a 3-b third-order △Σ modulator / IEEE J. Solid-State Circuits 35 (10) : 1453 ~ 1460
3. [학술지(정기간행물)] - Young-Shig Choi / 2006 / Gain- boosting charge pump for current matching in phase-locked loop / IEEE Trans. Circuits Syst. II, Express Briefs 53 (10) : 1022 ~ 1025
4. [학술지(정기간행물)] - Jae-Shin Lee / 2000 / Charge pump with perfect current matching characteristics in phase-locked loops / Electronics Letters 36 : 1907 ~ 1908
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