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대한전자공학회 전자공학회논문지-SD 電子工學會論文誌 第47卷 SD編 第1號
발행연도
2010.1
수록면
20 - 27 (8page)

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본 논문에서는 고성능 H.264/AVC 복호기 설계를 위해 디블록킹 필터의 수행시간 단축과 저전력 설계를 위한 필터링 순서 및 효율적인 메모리 구조를 제안하고 5단 파이프라인으로 구성된 필터의 설계에 대해 기술한다. 디블록킹 필터는 블록 경계에서 발생하는 왜곡을 제거하여 영상의 화질을 개선시키지만 하나의 경계에 여러 번 필터링을 수행하여 많은 메모리 접근과 반복되는 연산과정이 수반된다. 따라서 본 논문에서는 메모리 접근과 필터 수행 사이클을 최소화하는 새로운 필터 순서를 제안하고 반복되는 연산의 효율적 관리를 위해 파이프라인 구조를 적용하였다. 제안하는 디블록킹 필터는 메모리 읽기, 임계값 계산, 전처리 연산, 필터 연산, 메모리 쓰기로 구성된 5단 파이프라인으로 구현되어 순차적인 필터 연산에 병렬적 처리가 가능하며 각 단계에 클록 게이팅을 적용하여 하드웨어 자원에 불필요한 전력을 감소시켰다. 또한, 적은 내부 트랜스포지션 버퍼를 사용하면서 필터링 순서를 효율적으로 개선하여 필터 수행을 위한 메모리 접근과 수행 사이클을 감소시켰다.
제안하는 디블록킹 필터의 하드웨어는 Verilog HDL로 설계 하였으며 기존의 복호기에 통합하여 Modelsim 6.2g 시뮬레이터를 이용해 검증하였다. 입력으로는 표준 참조 소프트웨어 JM9.4 부호기를 통해 압축한 다양한 QCIF영상 샘플을 사용하였다. 기존 필터들과 수행 사이클을 비교한 결과, 제안하는 구조의 설계가 비교적 적은 트랜스포지션 버퍼를 사용했으며 최소 20%의 수행 사이클이 감소함을 확인하였다.
#디블록킹 필터 #H.264/AVC #파이프라인 #클럭 게이팅 #트랜스포지션 버퍼

목차

요약
Abstract
Ⅰ. 서론
Ⅱ. 디블록킹 필터 알고리즘
Ⅲ. 제안하는 디블록킹 필터
Ⅳ. 디블록킹 필터의 검증
Ⅴ. 결론
참고문헌
저자소개

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1. [기타자료] - S.Wenger / 2001 / Identified H.26L Applications / ITU-T SG 16 Doc google schola 2. [기타자료] - / 2005 / Draft ITU-T Recommendation and Final Draft International Standard of Joint Video Specification / Joint Video Team google schola 3. [학술지(정기간행물)] - 이성만 / 2008 / H.264/AVC를 위한 디블록킹 필터의 효율적인 VLSI 구조 / 전자공학회논문지 - SD 45 (7) : 52 ~ 60 dbpia 4. [학술대회논문] - D.Garrett / 1999 / Challenges in clockgating for a low power ASIC methodology / Proc. Int. Symp. Low Power Electron. Design : 176 ~ 181 google schola 5. [기타자료] - Souman Mandal / 2009 / Pipeline Processing / M-Tech I, IITB google schola

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