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논문 기본 정보
- 자료유형
- 학술저널
- 저자정보
- 발행연도
- 2010.3
- 수록면
- 25 - 34 (10page)
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본 논문에서는 주파수 배가 방법을 사용한 초고속 전압 제어 링 발진기를 제안하였다. 제안한 전압 제어 발진기는 TSMC 0.18um 1.8V CMOS 공정을 사용하여 설계하였다. 제안한 주파수 배가 방법은 한 주기 안에서 90°의 위상차를 가지는 4개의 신호를 AND-OR 연산하여 기본 신호의 두 배 주파수를 가지는 신호를 얻어내는 방법이다. 제안한 발진기는 차동 4단 링 발진기와 NAND 게이트를 사용하여 구성하였다. 전압 제어 링 발진기는 완전 차동 형태로 설계하여 정확하게 90°의 위상차를 가지는 4개의 신호를 얻을 수 있었으며 공통 모드 잡음에 대해 우수한 잡음 성능을 가지게 되었다. 주파수 배가회로는 AND나 OR 게이트에 비해 집적도가 뛰어난 NAND 게이트를 사용하여 AND-OR 연산을 구현하였다. 설계된 전압 제어 링 발진기는 컨트롤 전압에 따라 3.72㎓에서 8㎓의 출력 주파수를 가지며 4㎓에서 4.7mW의 소비 전력과 1㎒ 오프셋 주파수에서 -86.79dBc/Hz의 위상잡음 성능을 가짐을 검증하였다. 기존의 고속 전압 제어 링 발진기와의 비교에서도 모든 면에서 가장 뛰어난 성능을 보였고 저렴한 고속 주파수 합성기와 위상 고정 루프 등에 응용될 수 있음을 보였다.
목차
요약
Abstract
Ⅰ. 서론
Ⅱ. 기존의 고속 전압 제어 링 발진기
Ⅲ. 주파수 배가 방법
Ⅳ. 주파수 배가 방법을 이용한 전압 제어 링 발진기 설계
Ⅴ. 시뮬레이션 결과 및 분석
Ⅵ. 결론
참고문헌
저자소개
참고문헌 (9)
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1. [학술지(정기간행물)] - Seog-Jun Lee / 1997 / A Novel High-Speed Ring Oscillator for Multiphase Clock Generation Using Negative Skewed Delay Scheme / IEEE J. Solid-State Circuits 32 (2) : 231 ~ 289
2. [학술지(정기간행물)] - Lizhong Sun / 2001 / A 1.25 GHz 0.35 um Monolithic CMOS PLL Based on a Multiphase Ring Oscillator / IEEE J. Solid - State Cicuits 36 (6) : 910 ~ 916
3. [학술지(정기간행물)] - 김성하 / 2005 / 향상된 부 스큐 고속 VCO를 이용한 초고주파 PLL / 전자공학회논문지 - SC 42 (6) : 315 ~ 328
4. [단행본] - 박홍준 / 1999 / CMOS 아날로그 집적회로 설계 (상) / 시그마프레스
5. [학술지(정기간행물)] - Joonsuk Lee / 2000 / A Low-Noise Fast-Lock Phase-Locked Loop with Adaptive Bandwidth Control / IEEE J. Solid-State Circuits 35 (8) : 1137 ~ 1145
2. [학술지(정기간행물)] - Lizhong Sun / 2001 / A 1.25 GHz 0.35 um Monolithic CMOS PLL Based on a Multiphase Ring Oscillator / IEEE J. Solid - State Cicuits 36 (6) : 910 ~ 916
3. [학술지(정기간행물)] - 김성하 / 2005 / 향상된 부 스큐 고속 VCO를 이용한 초고주파 PLL / 전자공학회논문지 - SC 42 (6) : 315 ~ 328
4. [단행본] - 박홍준 / 1999 / CMOS 아날로그 집적회로 설계 (상) / 시그마프레스
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