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Ju-Hyun Park (Sungkyunkwan University) Sung Jin Kim (Sungkyunkwan University) Joo Young Lee (Sungkyunkwan University) Sang Hyeon Park (Sungkyunkwan University) Ju Ri Lee (Sungkyunkwan University) Sang Yun Kim (Sungkyunkwan University) Hong Jin Kim (Sungkyunkwan University) Kang-Yoon Lee (Sungkyunkwan University)
저널정보
대한전자공학회 IEIE Transactions on Smart Processing & Computing IEIE Transactions on Smart Processing & Computing Vol.4 No.5
발행연도
2015.10
수록면
371 - 378 (8page)

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In this paper, a different type of pulse width modulation (PWM) control scheme for a buck converter is introduced. The proposed buck converter uses PWM with frequency hopping and a low quiescent–current low dropout (LDO) voltage regulator with a power supply rejection ratio enhancer to reduce high spurs, harmonics and output voltage ripples. The low quiescent–current LDO voltage regulator is not described in this paper. A three-bit binary-to-thermometer decoder scheme and voltage ripple controller (VRC) is implemented to achieve low voltage ripple less than 3mV to increase the efficiency of the buck converter. An internal clock that is synchronized to the internal switching frequency is used to set the hopping rate. A center frequency of 2.5MHz was chosen because of the bluetooth low energy (BLE) application. This proposed DC-DC buck converter is available for low-current noise-sensitive loads such as BLE and radio frequency loads in portable communications devices. Thus, a high-efficiency and low-voltage ripple is required. This results in a less than 2% drop in the regulator’s efficiency, and a less than 3mV voltage ripple, with -26 dBm peak spur reduction operating in the buck converter.

목차

Abstract
1. Introduction
2. Frequency Hopping with Thermometer Decoder
3. Experimental Result
4. Conclusion
References

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