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논문 기본 정보
- 자료유형
- 학술대회자료
- 저자정보
- 발행연도
- 2015.11
- 수록면
- 206 - 209 (4page)
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This paper presents design of an 8-bit 1.8 V segmented current steering CMOS digital-to-analog converter (DAC). The DAC has been segmented as 6+2 to achieve good performance. Further, in order to decrease the mismatch, a calibration technique is used. The Experimental result of INL is 0.6 LSB and DNL is 0.5 LSB.
목차
Abstract
I. 서론
II. 본론
Ⅲ. 구현
Ⅳ. 결론 및 향후 연구 방향
참고문헌
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