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학술저널
저자정보
Jae-Hyuk Yang (Sungkyunkwan University) Sung-Woo Yoon (Sungkyunkwan University) Kee-Won Kwon (Sungkyunkwan University)
저널정보
대한전자공학회 JOURNAL OF SEMICONDUCTOR TECHNOLOGY AND SCIENCE Journal of Semiconductor Technology and Science Vol.18 No.3
발행연도
2018.6
수록면
373 - 382 (10page)
DOI
10.5573/JSTS.2018.18.3.373

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A mixed-mode digital-feedback duty-cycle corrector (DCC) with tracking logic is presented. The proposed DCC is implemented using a 65-nm CMOS process with a 1.2-V supply voltage. It achieves a rapid correction and a wide correction range using the successive approximation register (SAR) method. Furthermore, since the proposed corrector uses the tracking logic, a continuous duty-cycle correction is performed. Further, it accomplishes a duty-correction range of 35–65%, occupies an area of 225 x 117 um<SUP>2</SUP>, and requires 14 cycles for a correction. The resolutions are within 1 and 2% for the locking and tracking phases, respectively. The maximum operating frequency is 1 GHz, and the measured power consumption at 1 GHz is 3.6 mW.
#Duty-cycle corrector(DCC) #successive approximation register(SAR) #tracking logic #continuous correction

목차

Abstract
I. INTRODUCTION
II. ARCHITECTURE
III. CIRCUIT DESCRIPTION
IV. SIMULATION RESULTS
V. MEASUREMENT RESULTS
VI. CONCLUSION
REFERENCES

참고문헌 (8)

참고문헌 신청
Won-Joo Yun, Indal Song, Jung-Hwan Choi et al., “A digital DLL with hybrid DCC using 2-step duty error extraction and 180° phase aligner for 2.67Gb/S/pin 16Gb 4-H stack DDR4 SDRAM with TSVs”, ISSCC, pp. 322-323, Feb, 2015. You-Gang Chen, Hei-Wai Tsao, Chorng-Sii Hwang, “A Fast-Locking All-Digital Deskew Buffer With Duty-Cycle Correction”, IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Vol. 21, Issue 2, pp. 270-280, Feb, 2013. Yusong Qiu, Yun Zeng and Feng Zhang, “1-5GHZ duty cycle corrector circuit with wide correction range and high resolution”, Electronics letter, pp. 792-794, May, 2014. Young-Jae Min, Chan-Hui Jeong, Soo-Won Kim et al., “A 0.31?1 GHz Fast-Corrected Duty-Cycle Corrector With Successive Approximation Register for DDR DRAM Applications”, IEEE TRANSACTIONS ON VERY LARGE SCALE INTEGRATION (VLSI) SYSTEMS, Vol. 20, No. 8, pp. 1524-1528, Aug, 2012. Chan-Hui Jeong, Ammar Abdullah, Soo-Won Kim et al., “All-Digital Duty-Cycle Corrector With a Wide Duty Correction Range for DRAM Applications”, IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Vol. 24, Issue 1, pp. 363-367, Jan, 2016.

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