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저전력 설계를 위한 절단된 Booth 곱셈기 구조 ( A Truncated Booth Multiplier Architecture for Low Power Design )
전자공학회논문지-SD
2000 .09
Lower Power Booth Multiplier
대한전자공학회 학술대회
1998 .01
수정된 Booth 알고리즘을 이용한 고속 직병렬 곱셈기의 설계
전기학회논문지
1996 .08
역 매표창구수 결정 모형에 관한 연구
한국철도학회 학술발표대회논문집
2008 .11
저전력 바이패싱 Booth 곱셈기 설계
한국산업정보학회논문지
2013 .10
저전력 디지털 신호처리 응용을 위한 작은 오차를 갖는 절사형 Booth 승산기 설계
한국정보통신학회논문지
2002 .04
A Low-Power Booth Multiplier Using Data Partitioning
ITC-CSCC :International Technical Conference on Circuits Systems, Computers and Communications
2003 .07
Booth 인코더 출력을 이용한 저오차 고정길이 modified Booth 곱셈기 설계
한국통신학회논문지
2004 .02
새로운 복합모드로직과 사인선택 Booth 인코더를 이용한 고성능 32×32 bit 곱셈기의 설계 ( Design of a high performance 32×32-bit multiplier based on novel compound mode logic and sign select Booth encoder )
전자공학회논문지-SD
2001 .03
A Study on Optimum Pressure Vent of Experimental Booth by Gas Explosion
한국가스학회지
2007 .12
Radix-4 Modified Booth’s 알고리즘을 응용한 타원곡선 스칼라 곱셈
한국정보통신학회논문지
2004 .10
ETC 시스템의 최적 부스 개수 산정에 관한 연구
대한교통학회 학술대회지
2001 .10
Modified Booth 곱셈기를 위한 고성능 파이프라인 구조
전자공학회논문지-SD
2009 .12
CSA를 이용한 Booth-recording적용 16x16-bit High-radix 승산기의 구현과 분석
한국정보기술응용학회 학술대회
2001 .01
32X32 Booth Multiplier Capable of the Parallel Computations of 32 , 16 , 8 Bit Multimedia Data
ITC-CSCC :International Technical Conference on Circuits Systems, Computers and Communications
1998 .01
RB 연산과 Booth Recoding을 이용한 새로운 복소수 승산 알고리듬 ( A New Algorithm for Complex-Number Multiplication Using RB Arithmetic and Booth Recoding )
대한전자공학회 학술대회
1997 .07
RB 연산과 Booth Recoding을 이용한 새로운 복소수 승산 알고리듬
대한전자공학회 학술대회
1997 .06
Booth 알고리즘을 이용한 새로운 VQB 제산/제곱근 연산기의 설계
대한전자공학회 학술대회
1999 .11
파이프라인 기법을 이용한 고성능 modified Booth 곱셈기 설계
대한전자공학회 학술대회
2009 .11
Radix-4 Modified Booth 알고리즘과 CSA를 이용한 고속 RSA 암호시스템의 구현
한국통신학회 학술대회논문집
2001 .11
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