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논문 기본 정보

자료유형
학술저널
저자정보
김대운 (동아대학교) 강봉순 (동아대학교)
저널정보
한국정보통신학회 한국정보통신학회논문지 한국정보통신학회논문지 제25권 제12호
발행연도
2021.12
수록면
1,914 - 1,919 (6page)

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첨단산업의 발전에 따라 영상처리 하드웨어의 연구는 필수적이고, 실제 칩 동작을 위해서는 게이트 수준의 타이밍 검증이 필요하다. 이를 위해 주로 FPGA 기반 검증이 이루어지는데 기존에는 DDR3 메모리 인터페이스를 적용했지만, 최근에는 FPGA 스펙이 향상되면서 DDR4 메모리가 사용된다. 이 때 기존에 사용하던 메모리 인터페이스를 적용하면 CPU와 메모리의 성능 차이에 의한 신호들의 타이밍 불일치가 발생하기 때문에 사용할 수 없다. 본 논문에서는 기존 인터페이스 시스템 FSM의 State 최적화를 통해 문제를 해결하고, 이 과정에서 AXI Data Width 수정을 통해 데이터 읽기 속도를 2배 증가시킨다. 실제 사례 분석을 위해 Xilinx 사의 SoC보드 중 DDR3 메모리를 사용하는 ZC706과 DDR4 메모리를 사용하는 ZCU106을 사용한다.

목차

요약
ABSTRACT
Ⅰ. 서론
Ⅱ. FPGA 기반 메모리 인터페이스
Ⅲ. 기존 인터페이스의 문제점 및 개선
Ⅳ. 구현 결과
Ⅴ. 결론
References

참고문헌 (10)

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