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A 1.25 GHz Low Power Multi-phase PLL Using Phase Interpolation between Two Complementary Clocks
JOURNAL OF SEMICONDUCTOR TECHNOLOGY AND SCIENCE
2015 .12
영상데이터 전송을 위한 저전력 DDR2 Controller
Proceedings of KIIT Conference
2021 .06
실시간 시뮬레이션 시스템을 이용한 PLL 설계
Proceedings of KIIT Conference
2018 .06
LC 공진 클럭 네트워크에서의 멀티 코너 분석
대한전자공학회 학술대회
2015 .11
Benchmarking of Small-signal Dynamics of single-phase PLLs
ICPE(ISPE)논문집
2015 .06
무선 가속도 센서를 이용한 DDR 오락장치 구현
대한전자공학회 학술대회
2018 .06
Double-PLL을 이용한 홀 센서 기반 PMSM 제어의 위치 추정 성능 개선
전력전자학회논문지
2017 .06
호환성 및 속도 향상을 위한 FPGA 기반 DDR 메모리 인터페이스의 최적화
한국정보통신학회논문지
2021 .12
Study on Low-jitter and Low-power PLL Architectures for Mobile Audio Systems
JOURNAL OF SEMICONDUCTOR TECHNOLOGY AND SCIENCE
2022 .12
A Method to Improve the Performance of Phase-Locked Loop (PLL) for a Single-Phase Inverter Under the Non-Sinusoidal Grid Voltage Conditions
전력전자학회 학술대회 논문집
2017 .11
CMOS 120 GHz Phase-Locked Loops Based on Two Different VCO Topologies
Journal of Electromagnetic Engineering And Science
2017 .04
Design of a High-performance High-pass Generalized Integrator Based Single-phase PLL
JOURNAL OF POWER ELECTRONICS
2017 .09
180㎚ CMOS 2.4㎓ 저 위상 잡음 LC 탱크 발진기 설계
대한전자공학회 학술대회
2022 .06
166MHz 위상 고정 루프 기반 주파수 합성기
전기전자학회논문지
2022 .12
Forwarded-clock 수신기를 위한 Analog Front-end 설계
대한전자공학회 학술대회
2015 .06
Performance Analysis of Three-Phase Phase-Locked Loops for Distorted and Unbalanced Grids
JOURNAL OF POWER ELECTRONICS
2017 .01
IoT 어플리케이션을 위한 초저전력 PLL 설계
대한전자공학회 학술대회
2021 .06
DDR4 메모리 Command 데이터의 압축률 향상을 위한 전처리 기법
대한전자공학회 학술대회
2018 .06
스파인 구조를 갖는 클락 분배 네트워크의 특성 분석
대한전자공학회 학술대회
2015 .11
플래시 메모리 기반의 데이터베이스 시스템을 위한 BS-CLOCK 버퍼 교체 알고리즘
한국정보기술학회논문지
2016 .04
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