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학술저널
저자정보
Jin-Su Kang (Kumoh National Institute of Technology) Chang-Yong Lee (Kumoh National Institute of Technology) Yong-Hwan Lee (Kumoh National Institute of Technology)
저널정보
한국정보기술학회 한국정보기술학회논문지 한국정보기술학회논문지 제20권 제9호(JKIIT, Vol.20, No.9)
발행연도
2022.9
수록면
63 - 71 (9page)
DOI
10.14801/jkiit.2022.20.9.63

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각 메모리들은 정상 동작을 진행하기 전에 각자의 초기화 시퀀스가 존재한다. 이러한 시퀀스는 메모리가 오류 없는 정상 동작을 하기 위한 단계로서 필수적으로 진행되어야 한다. 본 논문에서는 1Gb LPDDR2(Low Power Double Data Rate)의 초기화 시퀀스를 자동으로 진행해 주는 메모리 컨트롤러의 시퀀스를 제안한다. 메모리의 초기화 시퀀스는 딜레이 타임 구간, 메모리 설정, 타이밍 조정 총 3단계로 나누어져 있다. 메모리 컨트롤러는 딜레이를 계산하고, 사용자의 설정에 맞추어 메모리의 초기 설정값을 조정하며 타이밍 조정을 위한 특정 패턴의 데이터를 쓰고 읽는다. 이러한 단계를 외부에서 진행하면 불필요한 시간 소모 및 정확한 운용이 어렵다. 본 논문에서 제안하는 메모리 컨트롤러를 사용하면 불필요한 시간 소모 없이 정확한 메모리 초기화 시퀀스의 진행이 가능하다.
#LPDDR2 memory #initialization sequence #memory controller #calibration #FPGA

목차

Abstract
요약
Ⅰ. Introduction
Ⅱ. LPDDR2 Memory
Ⅲ. Additional features
Ⅳ. Board test
Ⅴ. Conclusion
References

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