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학술저널
저자정보
이창현 (숭실대학교) 박창근 (숭실대학교)
저널정보
한국과학기술원 정보전자연구소 IDEC Journal of Integrated Circuits and Systems IDEC Journal of Integrated Circuits and Systems Vol.3 No.4
발행연도
2017.10
수록면
35 - 40 (6page)

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We designed the power amplifier using CMOS pro cess. The gain reduction by the bonded-wire and the low breakdown voltage problem of the device in the CMOS process are alleviated by applying a differential cascode structure. In order to reflect the distortion of the linearity in the driver stage, it is designed as 2-stage. An RC-feedback network was applied to the power stage to achieve low output impedance as well as high output power and efficiency. It is implemented using Magna/SKhynix 0.18μm 1P6M CMOS process. The total size is 0.7 x 1.7 mm² including pads. No oscillation occurred in all the measured bands. As a measurement results, output power and PAE were about 23 dBm / 13% in the CW signal, 20 dBm / 10% in the LTE signal, 18 dBm / 3% in the WLAN signal.

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