A Linear CMOS Power Amplifier with Inter-stage Transformer

이창현; 박창근

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자료유형: 학술저널

저자정보: 이창현 (숭실대학교) 박창근 (숭실대학교)

저널정보: 한국과학기술원 정보전자연구소 IDEC Journal of Integrated Circuits and Systems IDEC Journal of Integrated Circuits and Systems Vol.3 No.4

발행연도: 2017.10

수록면: 35 - 40 (6page)

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We designed the power amplifier using CMOS pro cess. The gain reduction by the bonded-wire and the low breakdown voltage problem of the device in the CMOS process are alleviated by applying a differential cascode structure. In order to reflect the distortion of the linearity in the driver stage, it is designed as 2-stage. An RC-feedback network was applied to the power stage to achieve low output impedance as well as high output power and efficiency. It is implemented using Magna/SKhynix 0.18μm 1P6M CMOS process. The total size is 0.7 x 1.7 mm² including pads. No oscillation occurred in all the measured bands. As a measurement results, output power and PAE were about 23 dBm / 13% in the CW signal, 20 dBm / 10% in the LTE signal, 18 dBm / 3% in the WLAN signal.

참고문헌 (7)

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King-Chun TSAI / 1999 / A 1. 9-GHz, 1-W CMOS class-E power amplifier for wireless communications / IEEE Journal of Solid-State Circuits 34(7):962~970

I. Aoki / 2002 / Distributed active transformer-a new powercombining and impedance-transformation technique / IEEE Transactions on Microwave Theory and Techniques 50(1):316~331

T. Joo / 2013 / A WLAN RF CMOS PA With Large-Signal MGTR Method / IEEE Transactions on Microwave Theory and Techniques 61(3):1272~1279

Y. Aoki / 2004 / A 20-mA quiescent current two-stage W-CDMA power amplifier using anti-phase intermodulation distortion / IEEE Radio Frequency Integrated Circuits (RFIC) Systems, Dig :357~353

H. Jeon / 2010 / A 40% PAE linear CMOS power amplifier with feedback bias technique for WCDMA applications / IEEE Radio Frequency Integrated Circuits (RFIC) Systems, Dig :561~564

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