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논문 기본 정보
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- 학술대회자료
- 저자정보
- 발행연도
- 2024.6
- 수록면
- 1,442 - 1,445 (4page)
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This paper proposes a counter structure for low-power single-slope ADC (SSADC) operation of a CMOS Image Sensor (CIS). This work minimized power consumption by tweaking the operation of the LSB flipflop and LSB+1 flipflop. The proposed counter was confirmed to have a power saving effect of 62.5% compared to the conventional counter through simulation. This work is expected to contribute to low-power SSADC design.
목차
Abstract
Ⅰ. 서론
Ⅱ. 기존 Counter 설계
Ⅲ. 제안하는 Counter 구조
Ⅵ. 시뮬레이션 결과
Ⅴ. 결론 및 향후 연구 방향
참고문헌
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