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논문 기본 정보
- 자료유형
- 학술대회자료
- 저자정보
- 저널정보
- 한국정보통신학회 INTERNATIONAL CONFERENCE ON FUTURE INFORMATION & COMMUNICATION ENGINEERING 2024 INTERNATIONAL CONFERENCE ON FUTURE INFORMATION & COMMUNICATION ENGINEERING Vo.15 No.1
- 발행연도
- 2024.1
- 수록면
- 123 - 126 (4page)
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This paper presents a binary field ECC processor designed to be resistant to side channel attacks (SCAs). The countermeasures, including randomized projective coordinates (RPC) and point validation (PV) techniques, and the modified Montgomery ladder algorithm that uses only x-coordinate (MMLAx), have been implemented in ECC processor to make it robust against a variety of SCAs. We performed SCA experiments on two ECC processors, one without SCA countermeasures and the other with SCA countermeasures, and experimentally demonstrated that our ECC processor designed with countermeasures was resistant to SPA and DPA attacks. Compared to the design without countermeasures, the SCA countermeasures implemented in our ECC processor used 2% and 1% more LUTs and flip-flops in the FPGA device, respectively, and increased the number of clock cycles required for point scalar multiplication (PSM) by 0.14%.
목차
Abstract
Ⅰ. INTRODUCTION
Ⅱ. Side-Channel Attacks to ECC
Ⅲ. ECC Processor with SCA Countermeasures and SCA Experiments
Ⅳ. CONCLUSIONS
REFERENCES
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